描述
IC693CPU374-GP
系统设计思路如下:ISP1581和MCU的连接采用断开总线模式,数据传输使用MDMA模式,ISP1581的16位DMA总线与FIFO的输出端相连,A/D模块的16位数据输出总线与FIFO的输入端相连。FIFO的写信号由定时芯片8254根据A/D采样频率产生,FIFO的读信号直接由ISP1581的DIOR给出(MDMA模式下),MDMA开始传输信号也由8254产生,连接到MCU的一个中断引脚,用于启动MDMA。ISP1581和8254的片选信号以及8254的地址、数据、控制等信号均在EPLD内产生。通过8254和EPLD的设置,可以保证FIFO读和MDMA写时序的配合。在本系统中,c8051f02x需要大量访问ISP1581的内部寄存器,因为c8051f系列采用数据空间和I/O空间统一寻址方式,必须采用full memory模式,即将ISP1581作为一个普通外设映射到c8051f02x外部存储空间的I/O空间。综上,最后的接口电路见图2。图中mode0、model、bus_conf等信号需要外接上拉下拉电阻。
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